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Die Veranstaltung HPR findet im WS 19/20 nicht statt!
Die Veranstaltung Heterogene Parallele Rechensysteme findet im WS 19/20 nicht statt. Im WS 20/21 findet HPR wieder wie gewohnt statt.
28.08.2019
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Basispraktikum TI: Hardwarenaher Systementwurf

Lecturers

Prof. Dr. Wolfgang Karl,
Oliver Mattes,
Fabian Nowak

Overview

Der Entwurf von Schaltungen und integrierten Schaltkreisen wurde früher sehr aufwendig schaltplangestützt mit diskreten Bauteilen durchgeführt. Heute wird diese Arbeit durch hochsprachlichen Entwurf mit Hilfe von Hardware­beschreibungs­sprachen erleichtert.

Im Rahmen dieses Basispraktikums sollen grundlegende Kenntnisse in Schaltungsbeschreibung, Simulation und Implementation durch verschiedene Übungsaufgaben erworben werden. Dies dient auch als Grundlage für weiterführenden Veranstaltungen (Vorlesung Rechnerstrukturen, Praktika, Studien- und Diplomarbeiten).

Inhalte des Praktikums:
  • Kennenlernen der Hardwarebeschreibungssprache VHDL
  • Einführung in verschiedene generische und herstellerspezifizsche Entwurfswerkzeuge
  • Einführung und Grundlagen programmierbarer Logikbausteine (FPGAs)
  • Schaltungsentwurf und -implementation
Voraussetzungen:
  • Interesse an Technischer Informatik
  • Vorlesung Technische Informatik ist von Vorteil

Organisation

Termin:
  • Die Einführungen zu den Arbeitsblättern finden dienstags von 13:10 bis ca. 14:00 Uhr im Zimmer A.U.10, Flügel A im Untergeschoß der Technologiefabrik statt.
  • Anwesenheit an allen Terminen ist Voraussetzung für den Erhalt des Scheins!
Allgemeines:
  • Die Lösungen der Aufgabenblätter müssen alle zwei Wochen abgegeben werden.
  • Je nach Arbeitstempo ist es möglich, dass die Bearbeitung der Aufgaben ausschließlich an den Praktikumsterminen nicht ausreicht.
Betreuer:
  • Das Praktikum wurde bis Ende Mai von Oliver Mattes betreut.
  • Danach gab es 2 Wochen Pause; am 04.06.2013 geb es keine Einführung.
  • Ab 18.06.2013 hat Fabian Nowak das Praktikum betreut.
Prüfung:
  • Die Prüfung fand Ende August 2013 statt. Details dazu fanden sich im Foliensatz 8 der Abschlussbesprechung.

Introduction and Tutorial Slides

Schedule Slides Exercises Delivery Date
17.04.2013, 14:00 Uhr, Raum B2-316.4, 2. Etage, TF Vorbesprechung - -
23.04.2013, TF, UG, Flur A,
Zi. A.U.10
VHDL, Simulatoren - -
07.05.2013, TF, UG, Flur A,
Zi. A.U.10
FPGAs, Xilinx-ISE - -
21.05.2013, TF, UG, Flur A,
Zi. A.U.10
VHDL-Entwurfsprozess - -
04.06.2013 Kein Praktikum - -
- Anmerkungen zu Blatt 3 und Tipps - -
18.06.2013, TF, UG, Flur A,
Zi. A.U.10
VGA-Ansteuerung - -
- Anmerkungen zu Blatt 4 und noch mehr Tipps - -
26/28.06.2013, 09:45 Uhr, TF, UG, Flur A,
Zi. A.U.10
Interaktive Steuerungslogik - -
- Musterlösung zu Blatt 4 und Tipps zur IEEE-Bibliothek - -
09.07.2013, TF, UG, Flur A,
Zi. A.U.10
Portierung - -
16.07.2013, TF, UG, Flur A, Zi. A.U.10 Besprechung Blatt 5 - -
- Evaluation - -
23.07.2013, TF, UG, Flur A, Zi. A.U.10 Abschlussbesprechung - -

TF = Technologiefabrik, Haid-und-Neu-Str. 7